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公开（公告）号CN122904820A | 申请号CN202611125262.X | 专利类型发明专利 |
状态在审 | 国家或地区CN | 申请人华芯巨数（杭州）微电子有限公司 |
分类号G06F30/3315(2020.01), G06F30/337(2020.01) | 申请日2026-07-28 | 公开日2026-10-13 |
发布日期2026-10-13 | 文档 ID84538566073800000 | 源数据页码328 |
专利语言zh | ||
本发明公开一种并行加速静态时序分析的方法，属于电子设计自动化领域，包括如下步骤：RCTree网络提取与数据结构初始化；基于广度优先搜索的RCTree拓扑排序，将所有节点划分到不同的层级中，并进行重排；将经过重排的数据传输至GPU显存；GPU并行计算下游电容；GPU并行计算互连线延迟；计算结果回传与时序图更新。本发明消除RCTree网络中节点间的强数据依赖，将串行的互连线延迟计算任务合理划分并映射到GPU线程模型上，从而实现互连线延迟的高效并行计算。
附图 1